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对芯片物理实现有天然的热情,乐于在时序收敛、功耗优化与物理验证中打磨每一处细节;具备严谨的工程素养,对从综合到签核的流程有系统性认知;善于在跨团队协作中主动对齐需求,推动复杂设计平滑落地;持续关注先进工艺演进,喜欢在工具与流程中寻找更优解。
精通多电压域划分与电源网络设计,结合动态电压频率调节(DVFS)和时钟门控技术,在物理实现中实现功耗与性能的折衷。
拥有5nm/4nm FinFET工艺节点流片经验,能应对高密度版图带来的寄生效应与工艺变异,通过寄生提取与静态时序分析联动优化时序收敛。
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