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在GitHub上发起“FPGA算法加速库”（https://github.com/niu****/FPGA-Accel-Lib），提供可配置的FFT、矩阵乘法、双线性插值等硬件模块，附带Testbench与资源对比脚本，获Star 1200+，Fork 600+
深度参与开源项目“SpinalHDL”的AXI4 Full互连模块开发，贡献PR 25+，设计并实现了跨时钟域处理子模块，同时为官方文档补充中文版接口时序说明，降低社区入门门槛
对数字逻辑与算法硬件化有近乎偏执的热情，享受从架构设计到时钟收敛的每一个细节；追求代码的简洁与可维护性，习惯在吞吐率、延迟和资源之间寻找最优解。多年深耕通信与视觉等领域的算法加速，具备从算法建模到板级验证的完整闭环能力，并积累多项发明专利。期待在更复杂的系统里，持续打磨高效、可靠的硬件加速方案。
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