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对数字音频与信号处理抱有持续热情,习惯用FPGA实现高效、低延迟的音频链路;代码注重可读性,相信清晰的寄存器级设计能减少后期调试成本。具备从算法仿真到硬件落地的闭环能力,对时钟域、资源与实时性保持敏感,抗压且乐于啃硬骨头。期望在音频/硬件方向持续深耕,用扎实的工程素养做出干净、可靠的声音方案。
精通多种低延迟设计方法,擅长根据FPGA BRAM/DSP阵列特性,对音频处理流水线进行模块化切割与寄存器穿插,消除长反馈路径中的时序瓶颈。
在某多通道会议音频处理终端中,引入跨时钟域乒乓缓冲与多维并行化FIR滤波器结构,将整体处理延迟从毫秒级压缩至亚毫秒级,同时保证资源占用率低于目标芯片的60%。
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