AMAZING RESUME / 01
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牛敬业
资深FPGA开发工程师
常怀探索之心,以实干沉淀自身价值
188****4727niu****@***.com北京32男资深FPGA开发工程师在职北京30k-40k •主修数字信号处理、电磁场与微波技术等核心课程,GPA排名专业前5%,完成基于FPGA的相控阵天线仿真系统
•担任电子创新实验室负责人,指导校级团队获全国大学生电子设计竞赛一等奖,设计智能巡检机器人控制系统
中兴通讯股份有限公司 - 有线产品线通信设备制造商
2012.07-2017.12
•负责4G/5G基站射频前端控制模块设计,采用SystemVerilog实现信道估计算法与自适应均衡器,优化多径衰落补偿机制
•主导跨部门联合仿真测试,通过VCS与ModelSim搭建软硬件在环验证环境,将联调周期缩短35%
•重构基带信号处理流水线,采用分布式RAM与FIFO深度动态配置策略,降低功耗18%并提升吞吐量
•解决Xilinx Kintex-7平台的DCM锁相环抖动问题,通过约束文件优化与PCB走线调整实现1.2GHz稳定工作
资深FPGA开发工程师边缘计算加速异构系统架构
北京
•带领6人团队开发边缘计算网关的实时视频分析模块,完成从需求分析到硅验证的全流程管理
•设计FPGA+DSP异构架构,通过AXI4-Stream总线实现H.265解码器与AI推理单元的协同处理
•优化卷积神经网络权重存储结构,采用压缩感知算法减少片上存储占用达40%
•建立CI/CD自动化验证流水线,集成UVM测试平台与Python脚本,使回归测试效率提升60%
4G基站物理层处理模块开发 - FPGA开发工程师
2014.03-2016.12
•项目背景:支撑运营商基站设备向Massive MIMO升级,需处理256天线阵列的波束赋形计算
•采用分布式FFT/IFFT架构,通过CORDIC算法实现相位校正,单通道处理时延控制在20μs内
•开发信道状态信息反馈压缩算法,在保持MIMO性能的前提下减少30%上行带宽占用
•完成与射频芯片组的联合测试,解决高速ADC采样时钟抖动问题,使BER指标达到1e-6
AI视频分析FPGA加速平台 - 资深FPGA开发工程师
2019.05-2021.06
•项目背景:为安防监控系统提供实时目标检测能力,需处理多路1080P视频流
•设计卷积加速器采用稀疏计算引擎,通过权重量化与通道剪枝使INT8推理速度提升45%
•开发硬件描述语言建模工具链,实现Python算子到FPGA IP核的自动化转换
•在智慧城市项目中部署300+节点,实现目标识别准确率98.7%与毫秒级响应
对硬件系统设计与可重构计算充满热忱,习惯用逻辑分析仪调试复杂时序,享受通过FPGA实现算法加速的成就感。工作严谨细致,擅长在资源受限场景下平衡性能与功耗,坚持编写模块化代码并建立完整验证体系。持续关注存算一体架构与 Chiplet 技术演进,定期参与 EDA 工具链的新技术评估。求职意向:希望加入重视底层技术积累的硬件团队,在 5G 通信或 AI 边缘计算领域深耕。
硬件描述语言(Verilog/SystemVerilog)
技术专利:
持有《一种面向5G基站的动态波束赋形方法》等4项发明专利,其中2项已进入实质审查阶段
技术社区贡献:
在GitLab维护开源FPGA视频编解码库,累计提交300+次代码,修复关键路径延迟计算缺陷