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熟练掌握Synopsys VCS、Verdi及UVM,搭建基于SystemVerilog的随机约束验证平台,高效捕获冒烟测试中的死锁断点。
作为验证负责人参与两颗AI SoC的流片,主导DDR子系统的功能覆盖率收敛,实现硅后一次点亮。
对芯片架构的极致追求深植于每一次设计迭代中,我习惯用严谨的逻辑与波形细节对话,对时序、功耗的敏感近乎本能。七年深耕让我沉淀出扎实的前端与架构功底,能快速拆解复杂系统、平衡性能与面积。带队攻关时,我更愿做技术锚点,以清晰沟通和务实标准牵引团队,持续交付稳定量产的设计。
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