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对硬件逻辑开发充满热情,习惯用状态机思维拆解复杂时序问题,追求代码的简洁与可维护性。擅长将抽象算法转化为高效硬件描述,坚持每日代码审查与版本管理,注重设计文档的实时同步。熟悉Xilinx与Intel主流芯片架构,乐于探索低功耗设计方法,期待在实时控制系统领域持续深耕。
参与OpenFPGA开源项目,负责时序优化模块开发,重构状态机架构使系统稳定性提升35%。
提交680行代码及测试用例,优化算法被社区采纳为v2.1版本标准功能。
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