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对数字逻辑与硬件加速设计保持极大热忱,习惯以代码洁癖雕琢每一行RTL。沉稳严谨,善于在复杂时序约束中寻找优雅解法,不回避性能瓶颈与调试压力。熟练驾驭主流器件与开发流程,能带领小团队高效协作;长期关注软硬件协同与架构演进,致力在FPGA工程师岗位上持续交付低延迟、高可靠的设计。
作为第一发明人,持有“一种基于FPGA的自适应均衡器”发明专利,已获国家知识产权局授权。
该专利方案已集成至公司通信产品信道处理模块,使信号抗干扰能力提升3dB,年节省授权IP成本超80万元,获评年度技术创新奖。
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