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运用SystemVerilog与Python搭建图像增强算法参考模型,通过HLS定点化仿真与FPGA板级回环测试,快速迭代性能并完成IP核交付,将算法移植周期缩短约40%。
对图像处理与硬件加速有浓厚兴趣,享受从算法到电路的精巧映射,乐于在时序约束下打磨每一行逻辑。保持严谨的工程习惯,对代码复用与模块化设计有执念,擅长在资源与性能间寻找平衡点。具备快速定位时序违例和吞吐瓶颈的直觉,适应跨团队协作节奏,期望在FPGA图像处理方向持续深耕。
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