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牛敬业
PCB Layout高级工程师
188****8864niu****@***.com北京35男PCB Layout高级工程师在职北京25k-35k 北京邮电大学 - 本科985/211通信/电子特色
2006.09-2010.06
•在校期间重点修读射频电路设计、高速数字电路、电磁兼容原理等课程，毕业设计以“基于USB 3.1 Type-C接口的差分布线策略与信号完整性验证”为题，从叠层规划到等长约束实现闭环验证，夯实了Layout工程化基础。
•作为硬件负责人参加全国大学生电子设计竞赛，主导完成一款基于FPGA的视频采集卡PCB设计，从原理图网表导入到六层板布局布线耗时缩减30%，最终斩获全国二等奖，快速积累了从设计到制板联调的全流程经验。
PCB Layout工程师高速板设计EDA工具应用DFM优化
北京
•主导车载域控制器主板的PCB Layout，从系统框图入手，独立完成8至14层板的元器件布局与走线规划。
•与结构、热设计工程师同步介入，针对高密度连接器区域进行3D空间干涉检查，确保整板装配无冲突。
•基于Cadence Allegro环境，每月交付2~3款高速板卡Layout，重点攻克DDR等长与SerDes差分对，平均首板成功率稳定在96%以上。
•梳理不同PCB供应商的制程能力，通过优化线宽线距、调整过孔类型，将单板加工成本降低约12%。
北京华创微电子有限公司 - 研发中心通信设备国家级专精特新
2015.01-至今
Senior PCB Layout EngineerLayout团队带领大尺寸高密度板板厂工艺协同
北京
•带领5人Layout团队，承接大型交换机与AI训练服务器主板的Layout任务，板厚覆盖20至28层，单板信号数量过万。
•建立并推行公司级Layout设计规范与Checklist，组织内部技术分享，使团队新人上手周期缩短30%。
•在系统架构评审中，从信号环路、电源分配角度提出布局调整建议，多次避免潜在EMC风险，提升方案一次通过率。
•与板厂进行深度技术对接，针对背钻、增层工艺制定双方认可的工艺窗口，解决多批次生产中的偏位与绿油气泡问题。
•主导6个千万级项目的Layout交付，通过并行化任务分配与模板化处理，平均项目周期压缩18%，产线不良率降低至0.4%以下。
工业机器人驱控一体板Layout项目 - 项目负责人
2016.05-2017.12
•负责一款工业机器人驱控一体板的PCB Layout，该板集成多轴电机控制与千兆以太网通信。
•作为项目负责人，从网表导入开始，梳理时钟树与关键信号路径，绘制关键信号流向图。
•布局阶段，将多路MOSFET驱动芯片与MCU进行热源分区，利用铜皮开窗与散热过孔阵列构建散热通道，并预留金属基板贴合区域。
•布线时，对多组LVDS差分信号进行严格等长和100Ω阻抗匹配，同时为模拟采样信号加屏蔽走线，防止数字地干扰。
•该板卡通过-40℃~85℃高低温测试，EMC认证一次通过，最终搭载于公司主力产品，累计出货量突破8万台。
•作为主设计师，参与一款数据中心高速背板的PCB Layout，该背板承担48个线卡与交换网板的互联，速率达56Gbps PAM4。
•项目面临严峻的信号完整性挑战，需处理近千对高速差分线，对串扰与回损要求极为苛刻。
•前期利用HyperLynx进行全链路仿真，依据眼图与S参数调整布线层叠、过孔反焊盘，将插损控制在-3dB以内。
•引入背钻技术消除过孔stub，并采用任意层互联工艺实现高密度走线，极大降低信号反射。
•协同硬件与结构工程师多轮迭代，最终板卡互联速率达标，误码率低于1E-15，成功应用于公司新一代数据中心交换机，获得客户高度认可。
我是一名对高速高密度PCB Layout充满执念的工程师，享受在毫厘之间将抽象电路化为精密实体的过程。十余年来，我始终保持着对信号完整性的高度敏感，每一次阻抗匹配、每一段等长绕线都力求逻辑严密、物理可靠。我性格沉稳，习惯用仿真数据代替直觉，善于在复杂约束与电磁兼容之间寻找最优解。同时，我乐于分享Layout规范与避坑经验，带领团队将设计一次成功率持续推高。我深信，一块经过反复雕琢的PCB板卡，是技术理性与工程美学的交汇，这正是我持续深耕的动力所在。
高速数字电路SI/PI仿真优化:
擅长运用HyperLynx、Ansys SIwave对PCIe Gen4链路、DDR4多负载拓扑进行前仿真与后仿真，通过S参数回波损耗分析微调过孔反焊盘尺寸，使通道插损在12.5GHz处改善0.8dB，直接指导Layout约束更新。
曾针对某22层通信板卡大电流电源网络，通过Cadence Sigrity PowerDC进行IR Drop仿真，定位并替换高阻抗过孔区域，将核心供电纹波由±5%压缩至±2.5%，保障了FPGA多路电源的瞬态响应，单板调试一版通过。
