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对模拟版图一直着迷，习惯把每一根走线、每一处匹配都当成手艺来雕琢，追求低噪声、高匹配与面积利用的务实平衡。做事沉稳细致，拿到规格后倾向先做器件级规划再动手布局，对寄生与可靠性的敏感几乎刻进操作习惯。工艺适配经验覆盖主流制程，能独立完成从顶层布局到验证闭环的全流程，并在面积与良率之间找到可量产的工程落点。乐于持续跟进先进工艺与设计方法，愿在严谨的版图深耕中把芯片做得更稳健、更干净。
拥有3项版图设计相关专利，例如“一种高速ADC的电容阵列对称布局结构”，该专利引入交叉耦合与屏蔽环设计，显著降低了寄生效应与失配，提升了高速模数转换器的动态性能。
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