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熟练运用Synopsys DC/ICC2、VCS、Verdi及Cadence Genus/Innovus等工具,搭建了从RTL风格检查、综合、时序收敛到物理设计的自动化脚本流水线,并引入PrimeTime进行静态时序分析,确保多工艺节点下的设计健壮性。
通过Python与Makefile构建了仿真回归调度引擎,实现批量测试用例的并行执行与结果自动比对,将整体验证周期间隔压缩约30%,显著提升了设计迭代效率。

对ARM芯片底层技术始终抱有热情,乐于在架构与指令集层级深挖细节,追求功耗、性能与面积的精细平衡。多年深耕形成从架构定义到量产交付的完整技术视野,作风务实,善于在复杂问题中快速拆解并给出可落地的判断。在性能调优、低功耗设计、底层驱动等方向积累了系统化实战经验,熟练运用EDA工具链与开发流程,能有效驱动项目闭环。多次作为核心角色推动芯片成功流片,兼具跨团队协作与项目推进能力,期待在硬核的ARM研发岗位上持续突破技术边界。
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