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熟练使用Synopsys VCS、Verdi及Cadence Xcelium进行全流程仿真调试,擅长利用断言和覆盖率驱动方法定位跨时钟域与边界条件缺陷。
熟悉ARMv8-A架构及AXI总线协议,曾参与一款基于Cortex-M0+的物联网SoC模块级验证,负责中断控制器和Timer的验证环境搭建。

对芯片验证抱有近乎偏执的热情,享受从千丝万缕的波形中定位隐藏缺陷的瞬间,始终追求验证完备性与零漏测。逻辑严谨、抗压耐烦,擅长在复杂约束下把测试场景拆解为可复用的随机化激励。深厚 SystemVerilog 与 UVM 功底,能快速构建可扩展的验证环境并优化覆盖率收敛。习惯以设计视角反向审视验证计划,乐于在跨团队碰撞中沉淀有效检查策略,持续为流片质量把好最后一关。
熟练使用Synopsys VCS、Verdi及Cadence Xcelium进行全流程仿真调试,擅长利用断言和覆盖率驱动方法定位跨时钟域与边界条件缺陷。
熟悉ARMv8-A架构及AXI总线协议,曾参与一款基于Cortex-M0+的物联网SoC模块级验证,负责中断控制器和Timer的验证环境搭建。
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