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对通信硬件始终怀有“让信号跑得更稳”的执着，享受从原理图到实测闭环的完整思考。严谨务实，习惯用指标与波形说话，对高速信号完整性和可靠性设计有天然敏感。具备扎实的电路仿真与调试功底，能快速定位跨层干扰与时钟抖动等疑难杂症。乐于在硬件迭代中追求功耗与成本的平衡，持续深挖射频前端与边缘计算场景的落地可能。
在 PCIe 4.0 转接卡项目中，运用差分对等长规则与阻抗计算器控制 90 Ω 差分阻抗，借助眼图模板验证信号质量。
利用自定义查询与脚本，批量替换过孔类型并自动生成泪滴，使高速布线迭代效率提升近一倍。
使用 Sigrity PowerSI 提取 PDN 阻抗曲线，结合 OptimizePI 优化去耦电容布局，将核心电压波动限制在 ±2.5% 以内。
在数模混合控制系统设计时，通过 Allegro 的 Team Design 分区协作，并用约束区域管理射频与数字信号隔离，确保 EMC 达标。
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